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CIRCUITOS SEQUENCIAIS Simulado: CCE0124_SM_201102146226 V.1 Fechar Aluno(a): JOYCE CARVALHO DE SANTANA Matrícula: 201102146226 Desempenho: 0,5 de 0,5 Data: 24/04/2015 07:56:41 (Finalizada) 1a Questão (Ref.: 201102420967) Pontos: 0,1 / 0,1 A frequência de um sinal de relógio, representada por f , é definida como sendo f = 1/T, onde T é o período do sinal. Portanto, se um circuito digital síncrono é cadenciado pelo uso de um sinal de relógio de 200 MHz. Qual é o maior atraso permitido no circuito? 3 ns 5 ns 0,5 ns 4 ns 1 ns 2a Questão (Ref.: 201102416309) Pontos: 0,1 / 0,1 A finalidade da entrada de clock num flip flop é: fazer com que a saída assuma o estado que depende das entradas de controle setar o dispositivo sempre provocar uma mudança de estado na saída as afirmativas (c) e (d) estão corretas resetar o dispositivo 3a Questão (Ref.: 201102420965) Pontos: 0,1 / 0,1 Em seu projeto, após a sua viabilidade, você usaria um circuito de Mealy, pois: Perturbações, eventualmente, ocorridas nas entradas(ruído, por exemplo) não afetam as saídas O circuito apresenta um hardware mais denso O circuito apresenta um hardware menos denso O circuito apresenta maior facilidade de deteção de erro quando comparado com o circuito de Moore O circuito apresenta um hardware incompatível 4a Questão (Ref.: 201102420961) Pontos: 0,1 / 0,1 Quando se utilizam flip-flops J-K, geralmente, os circuitos de excitação das entradas, são: Menos simples, pois, existem menos estados de indiferença. Menos simples, pois, existem mais estados de indiferença. Mais simples, pois, existem mais estados de indiferença. Mais simples, pois, não existem estados de indiferença Mais simples, pois, existem menos estados de indiferença. 5a Questão (Ref.: 201102420959) Pontos: 0,1 / 0,1 Quando se utilizam flip-flops tipo D, tem-se menos trabalho na obtenção das funções de excitação das entradas, pois existe(m): 4 entradas por flip-flop 2 entradas por flip-flop 3 entradas por flip-flop 1 entrada por flip-flop 5 entradas por flip-flop
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