Atividade para Avaliação - Semana 6 - Eletrônica Digital - EED001 - 2021 - UNIVESP - Engenharia da Computação - 10 de 10

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07/04/2021 Fazer teste: Atividade para avaliação - Semana 6 – ...
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Fazer teste: Atividade para avaliação - Semana 6 
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Este teste permite 3 tentativas. Esta é a tentativa número 1.
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Atividade para avaliação
1. Para responder a esta atividade, selecione a(s) alternativa(s) que você
considerar correta(s);
2. Após selecionar a resposta correta em todas as questões, vá até o �m da
página e pressione “Enviar teste”.
3. A cada tentativa, as perguntas e alternativas são embaralhadas
Consulte os gabaritos dessa disciplina no menu lateral.
Olá, estudante!
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PERGUNTA 1
Em uma memória EEPROM podemos a�rmar que:
ela só pode ser gravada expondo-a à UV.
ela só pode ser apagada expondo-a à UV.
ela só pode ser gravada quando o estado do sinal aplicado à
entrada de clock estiver em 1.
ela só pode ser gravada quando o estado do sinal aplicado à
entrada de clock estiver em 0.
ela só pode ser apagada aplicando-se um pulso de tensão
elevada.
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PERGUNTA 2
Para um conversor ADC de 12 bits que permite discriminar sinais
entre 2V e 5V inclusive, podemos a�rmar que um único bit
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p q
corresponde a uma variação de:
2,44 mV.
0,732 mV.
4,88mV.
0,293mV.
1,22mV.
 Verdadeiro
 Falso
PERGUNTA 3
A a�rmação “A grande desvantagem dos DACs de resistência
ponderada é a existências de correntes proporcionais às resistências,
resultando na necessidade da utilização de resistências de muito
baixa tolerância” é:
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PERGUNTA 4
Dado o circuito lógico abaixo, qual função ele implementa?
 
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PERGUNTA 5
Considerando o amplo espectro de tipos de conversores DACs é
correto a�rmar que:
conversores DAC  (sigma-delta) são mais rápidos e de melhor
resolução que conversores por aproximações sucessivas.
conversores DAC de dupla rampa possuem pior resolução que
conversores pipeline.
conversores Flash são mais rápidos e com melhor resolução que
conversores por aproximações sucessivas.
conversores DAC por aproximações sucessivas são mais rápidos
que conversores  (sigma-delta) mas tem pior resolução que
estes últimos.
conversores DAC de dupla rampa podem ser mais rápidos e
terem melhor resolução que conversores  (sigma-delta).
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PERGUNTA 6
Considerando portas dinâmicas CMOS podemos a�rmar que:
a lógica é realizada pelo bloco NMOS e possui dissipação
estática.
a lógica é realizada pelo bloco PMOS e não possui dissipação
estática.
a lógica é realizada pelo bloco NMOS e permite reduzir o número
de transistores.
a lógica é realizada pelo bloco PMOS e permite reduzir o número
de transistores.
a ligação entre Vdd e 0V é feita somente por chaves NMOS e não
possui dissipação estática.
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PERGUNTA 7
Um multivibrador astável com 555 onde C = 0,01microFarad, RA =
1,2k e RB = 80k apresenta um sinal em sua saída de período:
895Hz.
1,12 microssegundos.
7,29 kHz.
140 microssegundos.
1,12 milissegundos.
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 Verdadeiro
 Falso
PERGUNTA 8
A a�rmação “Um monoestável redisparável pode ser redisparado
enquanto estiver em seu estado quase estável, continuando a
temporização do intervalo de tempo tp, descontando o intervalo de
tempo já transcorrido” é:
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PERGUNTA 9
No caso de um conversor DAC é correto a�rmar que:
o valor de �m de escala normalizado é atingido pela codi�cação
mais elevada, todos os bits em 0.
quanto menor for o comprimento das palavras binárias (o
número de bits), menor será a diferença de valores convertidos
adjacentes.
o valor de �m de escala normalizado é atingido pela codi�cação
mais elevada, todos os bits em 1.
a diferença entre o valor de �m de escala normalizado e a
máxima saída do DAC é tanto menor quanto maior for o
comprimento das palavras binárias.
a diferença entre o valor de �m de escala normalizado e a
máxima saída do DAC é tanto menor quanto menor for o
comprimento das palavras binárias.
1 pontos   Salva
PERGUNTA 10
Um DAC recebe um sinal de entrada 0101011 e usa como referência
uma tensão de 3,3V. Qual o valor de tensão observado em sua saída?
3,35 V.
5,46 V.
1,11 V.
2,22 V.
2,73 V.
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