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Scanned by CamScanner
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o bloco do CS é sensível a borda de descida enquanto os outros blocos síncronos são sensíveis a borda de saída.
Na descida do clock o CS define o q será feito e na próxima subida o processador executa a ação.
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= · ? - = - = d
C rR . C ol, x b dZ D ? mI Z M H
§su, O ? m 4 0 A r? L i L A A
hJ jN vcA v A 5 » cmpfn
?eH : Q q D ? ?P D E Z 0 1 £n M ? M A ' A
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hT mAZC N k n n « oL A Q ihm ? W O S
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.
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um buffer que habilita um barramento de três estados
todo bloco que possuir um H possui tristate bus
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o tracejado não está dentro do processador...
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HLT trava o sinal de clock
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( ohJ S u W $ iN 5 W u coe l
h 6 » /p
h p crJp
su G W
0 uT
H L T
?A ¢A - csfp)
¢A
qA
'
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R ¢w W lN 5 T Q u{O h
b : O ? W 4 w o ? A / N S T L Z L )
L ; (
a = número de bits necessários para codificar as instruções
b= número de bits necessários ao endereçamento da memória de programa
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caso seja necessário acrescentar novas instruções, o código dessas deverá ser QQ número binário de 4bits que não seja 0, 1, 2, 14 e 15 que são os códigos já existentes no sap
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*Na memória de controle ficam salvas as micro-instruções de execução (HLT não entra na memória de controle);
*Ciclo de instrução é composta por busca + execução;
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Hb -> registro B (transforma o registro em um bidirecional)
Hc -> registro C (bidimensional) habilitador da leitura
Cc -> registro C (bidimensional) habilitador da escrita
Hl -> registro L (unidimensional, somente leitura )
Ch -> registro H (unidimensional, somente escrita)
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a 8
B 11
C 19
lcs 17
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*acreacentou-se o HC pois para utilizar o somador subtrator devemos mandar o q tá em RC pra RB (somador subtrator só relaciona RA com RB);
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*para encontrar o "B" tem q olhar o número de bits necessários para escrever o maior endereço. neste caso é o F45h (1111 0100 0101) ou seja, 12 bits
*são 6 instruções novas não 5 z=33
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TUDO ERRADO!!!
não são 5 novas, são seis
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HS,CA=1
* t1 a t3 são restritos a busca, de t4 a t6 são para as micro-instruções executáveis.
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HA,CM=1

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