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EXERCÍCIOS DE ARQUITETURA DE COMPUTADORES – V2 1. Seja uma memória principal de 4GB e uma memória cache associada de 64KB dividida em 1k linhas, com 64B de dados cada uma. Mostre como ficaria o formato de endereçamento para os mapeamentos direto, associativo e associativo por conjunto com 4 vias (linhas). 2. Qual é a capacidade em bytes de um chip de memória DRAM que possui 20 linhas de endereço e tamanho da célula com 4 bits? 3. Se um computador tem uma MP com disponibilidade de armazenar 264 bits e possui um barramento de dados com tamanho de 32 bits, qual o tamanho mínimo dos registradores REM, RDM, RI, IP? (Considere que o barramento de dados tem o tamanho de uma palavra). 4. O barramento local de um computador possui 64 bits de dados, 32 bits de endereço e clock de 66MHz. Qual a taxa de transferência máxima teórica deste barramento? Qual a capacidade de endereçamento deste barramento? 5. Um processador de 32 bits possui uma memória instalada máxima de 16MB no sistema. Supondo que o tamanho da célula de memória seja de 8 bits e que 10 dispositivos podem ser conectados nesse sistema. a) Quantos bits de endereço seriam usados para acessar um dos dispositivos em um sistema com E/S mapeada em memória? b) Quantos de bits de endereço seriam usados para acessar um dos dispositivos em um sistema com E/S isolada?
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