A arquitetura RISC (Reduced Instruction Set Computer) apresenta um conjunto restrito de instruções, executadas de forma altamente e�ficiente. Uma d...
A arquitetura RISC (Reduced Instruction Set Computer) apresenta um conjunto restrito de instruções, executadas de forma altamente e�ficiente. Uma das desvantagens desta arquitetura é:
O aumento do uso de registradores. A necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas. A grande necessidade de uso da memória. O aumento do consumo de energia do processador. A grande variedade de instruções disponíveis.
Uma das desvantagens da arquitetura RISC é a necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas.
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