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Em um mecanismo com memória virtual, o que acontece quando o hardware, ao converter um endereço lógico para físico, encontra o bit VI em 0 (inválido)?

O Hardware procura um frame livre para aquela página, aloca-a e acerta o bit na tabela.
O hardware devolve a CPU para o Sistema Operacional que irá avaliar se foi mesmo um acesso inválido ou apenas um Page Fault.
Ocorre um Page fault com a INT 2. O acesso será feito diretamente no arquivo de troca, em disco.
Ocorre um MIS e o gerenciador da cache busca na memória.
A conversão não é possível pois certamente o programa fez uma acesso inválido a memória.
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Computacional360

ano passado

Respostas

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ano passado

Na situação em que o hardware, ao converter um endereço lógico para físico, encontra o bit VI em 0 (inválido), o que acontece é que o hardware devolve a CPU para o Sistema Operacional que irá avaliar se foi mesmo um acesso inválido ou apenas um Page Fault. Portanto, a alternativa correta é: "O hardware devolve a CPU para o Sistema Operacional que irá avaliar se foi mesmo um acesso inválido ou apenas um Page Fault."

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Qual o problema que a paginação de memória resolveu?

Melhorou a taxa de MISS da cache.
Gargalo de von neumann.
Poder endereçar até 4GiB usando apenas o barramento de 20 bits do Intel.
Representar 20 bits de endereçamento com apenas 16 bits de ULA.
Relocação de código.

Qual é a ideia principal do mecanismo de memória virtual?

Evitar o gargalo de Von Neumann.
Realizar proteção de hardware mesmo no antigo processador 8088.
Usar o disco como memória.
Realizar uma conversão de endereços em 2 níveis.
Manter na memória apenas as poucas páginas realmente em uso.

O antigo XT, primeiro chip da intel que inaugurou a era PC:
I - Usava a técnica de paginação para gerenciamento de memória
II - Possuia 20 bits de tamanho de palavra
III - Podia endereçar até 1MiB
Apenas a III.
Apenas a II.
Apenas a I.
Todas.
Apenas a I e a III.

Com o uso da memória cache tem-se uma cópia de alguns dados em uma memória mais rápida.
I - Quando a ULA precisa de algo da memória, pede para a cache
II - Se o dado requerido pela ULA não está na cache, diz-se que houve um MISS. Neste caso a ULA solcitia então o dado diretamente à memória
III - O sucesso no desempenho da cache está no fato de ocorrerem muito mais casos de HIT do que de MISS
Apenas a I e a III.
Apenas a I.
Apenas a I e II.
Apenas a II e a III.
Apenas a II.

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