prova av

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Disciplina: ARQUITETURA DE COMPUTADORES  AV
Aluno: CARLOS EDUARDO NOGUEIRA DE ALMEIDA 202303179421
Professor: ANDRE SARMENTO BARBOSA
 
Turma: 9002
DGT0281_AV_202303179421 (AG)   14/03/2023 12:52:51 (F) 
Avaliação: 10,00 pts Nota SIA: 10,00 pts
 
00105-TETI-2006: LÓGICA DIGITAL  
 
 1. Ref.: 6111787 Pontos: 1,00  / 1,00
Usando as regras da álgebra booleana, selecione a alternativa que apresenta corretamente a simpli�cação da
expressão a seguir:
(A.~B) + (B.(A+C))
A + B
 A + (B . C)
A . B + C
A . B
A . (B + A) . C
 2. Ref.: 5286404 Pontos: 1,00  / 1,00
João foi à lanchonete e solicitou ao balconista um hamburguer (X) ou uma batata frita (Y) e um refrigerante (Z). Qual
expressão simboliza este pedido?
X . Y . Z
X . Y + Z
X + Y + Z
X + (Y . Z)
 (X + Y) . Z
 
00248-TETI-2006: COMPONENTES DE HARDWARE  
 
 3. Ref.: 5250385 Pontos: 1,00  / 1,00
A memória é organizada como um conjunto de N partes iguais, com cada parte possuindo um conteúdo �xo
de M bits.
A denominação especí�ca para cada parte é:
Largura
Partição
 Célula
Capacidade
Endereço
javascript:alert('C%C3%B3digo da quest%C3%A3o: 6111787.');
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5286404.');
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5250385.');
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 4. Ref.: 5250379 Pontos: 1,00  / 1,00
Depois de buscarem os dados na memória, os processadores interpretam o que fazer, por exemplo, que a
operação a ser executada é a de somar, e depois executam a operação propriamente dita. Cada operação a
ser executada é identi�cada e de�nida por um conjunto de bits denominado:
Ciclo de Instrução.
 Instrução de Máquina.
Dígito binário.
Operador.
Microcódigo.
 
00394-TETI-2006: PROCESSAMENTO EM PARALELO  
 
 5. Ref.: 5277754 Pontos: 1,00  / 1,00
A tecnologia que permite processamento paralelo em nível instruções, isto é, que possui vários pipelines em um
mesmo processador para processamento de mais de uma instrução simultaneamente é a:
SMP
Clusters
 Superescalar
Superpipeline
NUMA
 
00403-TETI-2009: BASE COMPUTACIONAL  
 
 6. Ref.: 6108638 Pontos: 1,00  / 1,00
A colocação de memória cache no projeto de um computador é um artifício para melhorar sua performance. Quanto
a essa memória, podemos a�rmar que:
 Fica presente no processador e aumenta a e�ciência por ser mais rápida que a memória principal.
Fica presente no disco rígido e melhora a velocidade de leitura do disco.
Fica presente na Memória RAM e melhora a performance, porque consegue transferir dados mais rápidos
para o processador.
Fica presente na placa-mãe e tem menor latência de transmissão.
Fica presente em um cartão USB e permite guardar em segurança os arquivos.
 7. Ref.: 6109014 Pontos: 1,00  / 1,00
Com o crescimento da internet, foi necessário criar um sistema de endereçamento para que se enviassem os
datagramas ao destino correto. Originalmente, era chamado apenas de endereço IP, mas, hoje, chama-se Ipv4.
Assinale a opção que representa um endereço IP válido:
8.8.44
312.0.255.100
 8.8.4.4
925
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5250379.');
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5277754.');
javascript:alert('C%C3%B3digo da quest%C3%A3o: 6108638.');
javascript:alert('C%C3%B3digo da quest%C3%A3o: 6109014.');
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200.100.30.25.42
 
00432-TETI-2009: REPRESENTAÇÃO DE DADOS  
 
 8. Ref.: 5004261 Pontos: 1,00  / 1,00
O último símbolo possível de ser representado na base numérica 14 é o:
F
E
B
C
 D
 9. Ref.: 5013262 Pontos: 1,00  / 1,00
Suponha que, para efeitos de aprendizagem em arquitetura de computadores (ignorando vários detalhes de
implementação), você decidiu criar uma representação de conjunto de instruções hipotético muito simples e
limitado para operações aritméticas de inteiros positivos com dois operandos, de um processador de 4 bits,
cuja palavra de dados é de 4 bits.
 
É gasto 1 ciclo de instrução para cada palavra, e a quantidade de ciclos para execução de uma determinada
instrução (operadores e operandos) é igual à quantidade de palavras dessa instrução.
 
O conjunto de instruções está representado a seguir:
Qual é o resultado em binário da operação 1101 1001 0100?
0101
 0010
0001
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5004261.');
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5013262.');
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0100
0011
 
00436-TETI-2006: ARQUITETURA CISC X RISC  
 
 10. Ref.: 5225067 Pontos: 1,00  / 1,00
Um projetista está interessado em criar um processador de arquitetura híbrida, buscando combinar as
melhores características das arquiteturas CISC e RISC.
Quais das seguintes características podem ser por ele empregadas?
Muitas instruções e muitos registradores.
Endereçamento múltiplo e poucos registradores de uso geral.
 Variadas instruções e pipeline e�ciente para as instruções mais comuns.
Muitos registradores e pipeline e�ciente para as instruções comuns.
Poucas instruções e poucos registradores.
javascript:alert('C%C3%B3digo da quest%C3%A3o: 5225067.');