EDG Lista de Exercicios 3

UFU \ue003\u2010\ue003 Eletrônica \ue003 Digital \ue003 \u2013 \ue003 2017 \u2010 2 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003 1/2 \ue003 \ue003 \ue003 Lista \ue003 de \ue003 Exercícios \ue003 3 \ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 Prof. \ue003 Ernane \ue003 Coelho \ue003 _____________ __ ______ _____ ____ ___ _____ _____ _____ _____ ___ ____ ______ _____ __ _____ _____ _____ __ ______ _____ ____ ___ _____ _____ _ \ue003 1. O \ue003 que \ue003 são \ue003 contadores \ue003 síncronos \ue003 e \ue003 assíncronos? \ue003 \ue003 2. O \ue003 que \ue003 é \ue003 módulo \ue003 de \ue003 um \ue003 contador \ue003 digital ? \ue003 \ue003 3. Quantos \ue003 flip \u2010 flops \ue003 são \ue003 necessários \ue003 para \ue003 a \ue003 implementação \ue003 de \ue003 um \ue003 contador \ue003 digital \ue003 que \ue003 conte \ue003 de \ue003 0 \ue003 a \ue003 8000? \ue003 \ue003 4. Implemente \ue003 um \ue003 contador \ue003 digital \ue003 crescente \ue003 com \ue003 módulo \ue003 11. \ue003 \ue003 5. Projete \ue003 um \ue003 circuito \ue003 digital \ue003 sequen cial \ue003 utilizando \ue003 flip \u2010 flops \ue003 tipo \ue003 D \ue003 para \ue003 obter \ue003 um \ue003 sin al \ue003 de \ue003 clock \ue003 de \ue003 25 \ue003 MHz \ue003 a \ue003 partir \ue003 de \ue003 um \ue003 sinal \ue003 de \ue003 clock \ue003 de \ue003 100MHz. \ue003 \ue003 6. O \ue003 contador \ue003 aprese ntado \ue003 na \ue003 figura \ue003 abaixo \ue003 é \ue003 síncrono \ue003 ou \ue003 assíncrono? \ue003 Determine \ue003 a \ue003 sequência \ue003 de \ue003 contagem \ue003 do \ue003 contador. \ue003 \ue003 7. Projete \ue003 um \ue003 contador \ue003 digital \ue003 que \ue003 opere \ue003 na \ue003 seguinte \ue003 sequência: \ue003 0,1,3,6,11,15, \ue003 repete \ue003 0,1,3... \ue003 \ue003 8. Implemente \ue003 um \ue003 contador \ue003 digital \ue003 síncrono \ue003 \u201cinicializável\u201d \ue003 com \ue003 a \ue003 sequência \ue003 mostrada \ue003 na \ue003 figura \ue003 abaixo. \ue003 \ue003 9. O \ue003 que \ue003 é \ue003 uma \ue003 máquina \ue003 de \ue003 estados \ue003 finitos \ue003 (FSM)? \ue003 Qual \ue003 a \ue003 diferença \ue003 entre \ue003 as \ue003 FSM \ue003 Mealy \ue003 e \ue003 Moore? \ue003 \ue003 10. Projete \ue003 uma \ue003 FSM \ue003 do \ue003 tipo \ue003 Moore \ue003 para \ue003 reconhecer \ue003 uma \ue003 sequência \ue003 de \ue003 bits \ue003 \u201c110\u201d \ue003 presente \ue003 num \ue003 trem \ue003 de \ue003 pulsos \ue003 aplicado \ue003 ao \ue003 sinal \ue003 de \ue003 entrada. \ue003 Desenhe \ue003 o \ue003 diagrama \ue003 de \ue003 temporização \ue003 para \ue003 os \ue003 sinais \ue003 de \ue003 clk, \ue003 UFU \ue003\u2010\ue003 Eletrônica \ue003 Digital \ue003 \u2013 \ue003 2017 \u2010 2 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003 2/2 \ue003 \ue003 \ue003 Lista \ue003 de \ue003 Exercícios \ue003 3 \ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 \ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003\ue003 Prof. \ue003 Ernane \ue003 Coelho \ue003 _____________ __________ _____________ ____________ __________ _____________ __________ ____________ ____________ ___________ ___ \ue003 estados \ue003 e \ue003 saída \ue003 da \ue003 FSM \ue003 projetada \ue003 considerando \ue003 um \ue003 sequência \ue003 de \ue003 bits \ue003 arbitrária \ue003 na \ue003 entrada, \ue003 a \ue003 qual \ue003 eventualmente \ue003 contém \ue003 \u201c110\u201d. \ue003 \ue003 11. Considere \ue003 a \ue003 FSM \ue003 ap resentad a \ue003 na \ue003 figura \ue003 abaixo. \ue003 Como \ue003 esta \ue003 pode \ue003 ser \ue003 classificada: \ue003 Mealy \ue003 ou \ue003 Moore? \ue003 Justifique. \ue003 Escreva \ue003 as \ue003 equações \ue003 de \ue003 excit ação \ue003 dos \ue003 flip \u2010 flops \ue003 e \ue003 do \ue003 circuito \ue003 combi nacional \ue003 de \ue003 saída. \ue003 Elabore \ue003 as \ue003 tabelas \ue003 de \ue003 excitação \ue003 e \ue003 transição \ue003 de \ue003 estados \ue003 da \ue003 FSM. \ue003 Consid ere \ue003 ainda \ue003 o \ue003 diagrama \ue003 de \ue003 temporização \ue003 apresentado \ue003 na \ue003 figura, \ue003 onde \ue003 os \ue003 sinais \ue003 de \ue003 clk \ue003 e \ue003 entrada \ue003 já \ue003 estão \ue003 determinados. \ue003 Comple te \ue003 o \ue003 diagrama, \ue003 desenhando \ue003 os \ue003 sinais \ue003 de \ue003 saída. \ue003 \ue003 \ue003 \ue003 \ue003 12. Considere \ue003 a \ue003 FSM \ue003 da \ue003 figura \ue003 abaixo. \ue003 Esta \ue003 é \ue003 Mealy \ue003 ou \ue003 Moore? \ue003 Complete \ue003 o \ue003 diagrama \ue003 de \ue003 temporização \ue003 também \ue003 apresentado \ue003 na \ue003 figura. \ue003 Desenhe \ue003 o \ue003 diagrama \ue003 de \ue003 estados \ue003 que \ue003 representa \ue003 a \ue003 FSM. \ue003 \ue003 \ue003

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