Exercício Arq. de Computadores - Cap 4

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|Cap. 04|
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|4.1 Quais são as diferenças entre acesso sequencial, acesso direto e acesso aleatório?
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|R: Acesso direto: Mecanismo de leitura/escrita.
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| Acesso sequencial: Memória organizada em unidades de registros.
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| Acesso aleatório: Memória tem um mecanismo constante.
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|4.2 Qual é o relacionamento geral entre tempo de acesso, custo de memória e capacidade?
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|R: Tempo de acesso (latência): Para a memória de acesso aleatório, esse é o tempo gasto para realizar uma operação de leitura e escrita.
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| Tempo de ciclo de memória: Esse tipo é aplicado ao acesso aleatório, sendo o tempo de acesso mais qualquer tempo adicional antes que um segundo acesso possa iniciar.
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| Taxa de transferência: Essa é a taxa em que os dados podem ser transferidos para dentro ou fora de uma unidade de memória.
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 4.3 Como o princípio de localidade se relaciona com o uso de múltiplos níveis de memória?
Mantem-se na memória menor e mais rápida os dados mais frequentemente utilizados (blocos) e nas demais as partes maiores do programa sendo 
que ao procurar uma instrução a chance de ela estar nessa memória mais rápida é grande e os erros – embora existam – 
são minimizados por meio de algoritmos de substituição.
4.4 Quais são as diferenças entre mapeamento direto, mapeamento associativo e mapeamento associativo em conjunto?
Mapeamento direto – Cada bloco da memória principal é mapeado em uma única linha da cache.
Mapeamento associativo – Permite que cada bloco da memória principal seja carregado em qualquer linha da memória cache.
Mapeamento associativo em conjunto – Combina as vantagens do mapeamento direto e do mapeamento associativo e diminui suas desvantagens.
A memória cache é dividida em x conjuntos de n linhas.
4.5 Para uma cache mapeada diretamente, um endereço de memória principal é visto como consistido em três campos.Liste e defina os três campos.
São eles: W bits, S bits e R bits.
W Bits – Identificam uma palavra ou um byte dentro de um bloco da memória principal.
S Bits – Os s bits especificam um dos 2 blocos restantes da memória principal.
R Bits – Campo de linha de bits mais significante.
4.6 Para uma cache associativa, um endereço de memória p principal é visto como consistido em três campos. Liste e defina os três campos.
São eles: Tags e Palavra.
Tags – Identifica o bloco da memória principal para determinar se um bloco está na cache.
Palavra – Cada palavra é mapeada para múltiplas linhas de cache.
4.7 Para uma cache associativa em conjunto, um endereço de memória principal é visto como consistido em três campos. Liste e defina os três campos.