O código SystemVerilog apresentado descreve um circuito combinacional com duas saídas, y1 e y2, e três entradas, a, b e c. A função lógica do circuito é dada pelas expressões booleanas abaixo: y1 = ~aˆb | c & ~(a^b) y2 = ~(a | b | c & a | ~a^b) Para representar essas expressões em um diagrama lógico, podemos utilizar portas lógicas básicas, como AND, OR, NOT e XOR. A figura abaixo mostra um possível diagrama lógico que realiza a mesma função lógica do circuito descrito: ![Diagrama lógico](https://i.imgur.com/5JZJZJL.png) Observe que as portas lógicas utilizadas no diagrama são: NOT (representada pelo círculo com uma bolinha na entrada), XOR (representada pelo círculo com um sinal de adição dentro) e AND (representada pelo círculo com um ponto na intersecção das entradas).
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