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Dadas as sentenças da lógica de 1ª ordem:
I) x(x)→x(x)
II) x((x)  (x)) → (x(x)  x (x))
III) xy(x,y)  xy(x,y)
IV) x(x) → x(x)
a) Informe se cada sentença é uma tautologia, satisfazível mas não tautologia, ou insatisfazível.
b) Para cada sentença, faça o que se pede a seguir:
• Se a sentença for uma tautologia: demonstre esse fato usando a definição de consequência semântica, sem usar equivalências entre sentenças;
• Se a sentença for satisfazível, mas não tautologia: exiba uma interpretação em uma estrutura que a torne verdadeira e em outra que a torne falsa;
• Se a sentença for insatisfazível: demonstre esse fato usando a definição de consequência semântica, sem usar equivalências entre sentenças.


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Testando o Conhecimento

há 2 anos

Respostas

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há 2 anos

a) I) Satisfazível mas não tautologia. II) Tautologia. III) Satisfazível mas não tautologia. IV) Insatisfazível. b) I) A sentença é satisfazível, mas não é uma tautologia. Para mostrar isso, podemos construir uma interpretação em que a sentença é verdadeira e outra em que é falsa. Por exemplo, considere o domínio {0, 1} e a interpretação em que α(x) é verdadeira para x = 0 e falsa para x = 1. Nessa interpretação, a sentença é verdadeira, pois existe um valor de x (0) para o qual α(x) é verdadeira e, portanto, a implicação é verdadeira. No entanto, se considerarmos a interpretação em que α(x) é falsa para todos os valores de x, a sentença é falsa, pois a implicação não é satisfeita. II) A sentença é uma tautologia. Para mostrar isso, podemos usar a definição de consequência semântica. Suponha que temos uma interpretação I e uma valoração v em I. Se a sentença II não for verdadeira em I sob v, então deve haver um valor de x para o qual ¬(ϕ(x) ∨ ψ(x)) é verdadeiro em I sob v. Isso implica que tanto ¬ϕ(x) quanto ¬ψ(x) são verdadeiros em I sob v. Mas isso significa que tanto ∀xϕ(x) quanto ∀xψ(x) são falsos em I sob v, o que implica que a disjunção ∀xϕ(x) ∨ ∀xψ(x) é falsa em I sob v. Portanto, a sentença II é uma tautologia. III) A sentença é satisfazível, mas não é uma tautologia. Para mostrar isso, podemos construir uma interpretação em que a sentença é verdadeira e outra em que é falsa. Por exemplo, considere o domínio {0, 1} e a interpretação em que δ(x, y) é verdadeira para x = 0 e y = 1. Nessa interpretação, a sentença é verdadeira, pois para todo valor de x existe um valor de y para o qual δ(x, y) é verdadeira. No entanto, se considerarmos a interpretação em que δ(x, y) é falsa para todos os valores de x e y, a sentença é falsa, pois nem a primeira nem a segunda disjunção são satisfeitas. IV) A sentença é insatisfazível. Para mostrar isso, podemos usar a definição de consequência semântica. Suponha que temos uma interpretação I e uma valoração v em I. Se a sentença IV não for verdadeira em I sob v, então deve haver um valor de x para o qual σ(x) é verdadeiro em I sob v e ¬σ(x) é falso em I sob v. Mas isso é uma contradição, pois não pode haver um valor de x para o qual σ(x) é verdadeiro e ¬σ(x) é falso. Portanto, a sentença IV é insatisfazível.

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1a QUESTÃO
Valor: 1,0
A pilha de protocolos TCP/IP (Transmission Control Protocol / Internet Protocol), diferentemente do modelo de referência OSI (Open Systems Interconnection), não tem a camada de sessão. No entanto, um protocolo da camada de aplicação pode incluir algumas funcionalidades definidas nessa camada, caso necessário. O protocolo de transferência de arquivos (FTP - File Transfer Protocol) faz parte da camada de aplicação da arquitetura TCP/IP e incorpora algumas funções da camada de sessão do modelo OSI. Baseado na afirmativa acima, descreva uma função da camada de sessão que é utilizada pelo protocolo FTP.


4a QUESTÃO
Valor: 1,0
Dado um sistema operacional que utiliza Paginação sob Demanda como gerência da memória e oferece multiprogramação através de um algoritmo de escalonamento, responda às questões abaixo:
a) Considere que o endereço virtual é dividido conforme apresentado na figura abaixo.
Número da página
Deslocamento
20 bits 12 bits

Quantas entradas tem a tabela de páginas e qual o tamanho da página?

b) Considere que um processo tem quatro quadros alocados preenchidos com as páginas indicadas na tabela abaixo. A tabela também contém o instante de carga da página na memória, o instante da última referência, e o valor do bit de referência (R) (os tempos estão em ticks de relógio).

Página Carga Última ref. R
0 120 300 1
1 200 250 0
2 140 270 0
3 110 285 1

Dado que o processo deseja acessar a página 4, qual página


c) Considerando que a maioria das aplicações executadas neste sistema são iterativas, qual é o melhor algoritmo de escalonamento a se usar, o Round Robin (Circular) ou o FCFS (First Come First Served)? Justifique sua resposta.


Para os dados de entrada n = 4, e para as frequências dos símbolos seguintes, si A B C D fi 5 1 2 1
a) mostre a árvore T de prefixo mínima obtida usando o algoritmo de Huffman para esses dados de entrada;
b) preencha (no caderno de soluções) a tabela a seguir com as palavras-código construídas a partir da árvore T;
c) determine o custo C(T) da árvore obtida pelo algoritmo de Huffman.


Com base no esquema acima, elabore os comandos em SQL que atendam aos seguintes pedidos:
a) Obter as siglas dos partidos com mais de dez parlamentares eleitos para o mandato em vigor.
b) Recuperar os nomes dos parlamentares que participaram, sem se abster, de todas as votações ocorridas durante algum de seus mandatos.


Em uma linguagem que contenha os lexemas abaixo, apresente o autômato finito que represente os estados do Analisador Léxico. ';' , '+' , '+=' , '++' , ':=' , '!' , '!=' , (a..zA..Z)+ , (0..9)+['.' (0..9)+]


Com relação à Arquitetura apresentada, a) apresente um esquema das instruções R-R e R-M de acordo com o formato abaixo, preenchendo as lacunas (no caderno de solução) com o valor correto da numeração de bits para que seja possível implementar a arquitetura proposta, com OFFSET de tamanho máximo;


Com relação à Arquitetura apresentada, b) faça um esquema de processador que implemente a arquitetura proposta, usando os componentes listados abaixo e explicitando as conexões entre eles. Obs.: 1. Em caso de divisão de trilha, os bits que seguem por cada trilha devem ser identificados. 2. Adicione multiplexadores 2x1 quando necessário. 3. O processador deve executar minimamente as operações R-M: Load word (LW) e Store Word (SW) e operações R-R (como por exemplo ADD). Componentes: - Contador de Programa (PC); - Incrementador de 4 posições; - Memória de Instruções; - Banco de Registradores; - Extensor de sinal para 32 bits; - Unidade Lógica e Aritmética (ULA) de 32 bits; e - Memória de dados.


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